Zilog Z8F0130 Bedienungsanleitung Seite 6
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- Inhaltsverzeichnis
- LESEZEICHEN
Bewertet. / 5. Basierend auf Kundenbewertungen
eZ8
™
CPU Core
User Manual
UM012820-0810 Table of Contents
vi
Register File Organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Register File Precautions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Program Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Data Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
Stacks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Addressing Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Register Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Register Addressing Using 12-Bit Addresses . . . . . . . . . . . . . 28
Register Addressing Using 8-Bit Addresses . . . . . . . . . . . . . . 29
Register Addressing Using 4-Bit Addresses . . . . . . . . . . . . . . 29
Escaped Mode Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Indirect Register Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Indexed Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
Direct Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
Relative Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Immediate Data Addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Interrupt Enable and Disable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Interrupt Priority . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Vectored Interrupt Processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Nesting of Vectored Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Polled Interrupt Processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Software Interrupt Generation . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
Illegal Instruction Traps . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
Symbolic Operation of an Illegal Instruction Trap . . . . . . . . . . . . . 45
Linear Programs That Do Not Employ The Stack . . . . . . . . . . 46
eZ8
™
CPU Instruction Set Summary . . . . . . . . . . . . . . . . . . . . . . . . 47
Assembly Language Source Program Example . . . . . . . . . . . . . . 48
Assembly Language Syntax . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48
eZ8 CPU Instruction Notation . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50
- CPU Core 1
- UM012820-0810 2
- Revision History 3
- Table of Contents 4
- Manual Objectives 10
- Manual Conventions 12
- Parentheses 13
- Safeguards 14
- Abbreviations/Acronyms 15
- Architectural Overview 16
- Fetch Unit 17
- Execution Unit 18
- Stack Pointer Registers 19
- Register Pointer 20
- Flags Register 20
- Condition Codes 23
- Arithmetic Logic Unit 24
- Byte Ordering 25
- Compatibility 26
- New Function Instructions 27
- CPU Instruction Set De 28
- Alternate Function Op Code 29
- Moved Instructions 29
- Removed Instructions 29
- Compatibility with Z8 CPU 30
- Stack Pointer Compatibility 31
- Reset Compatibility 31
- Interrupt Compatibility 31
- Address Space 32
- CPU Control Registers 33
- General-Purpose Registers 33
- Register File Organization 33
- UM012820-0810 Address Space 34
- {RP[3:0], RP[7:4] 35
- Address[3:0]} 35
- Program Memory 38
- Data Memory 39
- Interrupts 42
- Interrupt Priority 43
- Vectored Interrupt Processing 43
- Polled Interrupt Processing 46
- Software Interrupt Generation 47
- UM012820-0810 Interrupts 48
- Addressing Modes 49
- Register Addressing 50
- RP[3:0]. The full 12-bit 51
- {RP[3:0], Address[7:0]} 51
- Escaped Mode Addressing 52
- Indirect Register Addressing 54
- Indexed Addressing 56
- Direct Addressing 57
- Relative Addressing 58
- Immediate Data Addressing 59
- Illegal Instruction Traps 60
- CPU Instruction Set 62
- Assembly Language Syntax 63
- UM012820-0810 eZ8 67
- CPU Instruction Set Summary 67
- Description 86
- INSTRUCTION MNEMONIC 87
- Mnemonic 105
- Destination 105
- Op Code 105
- User Manual 107
- CALL @A4h 129
- Object Code: D4 A4 129
- UM012820-0810 CCF Instruction 131
- Sample Usage 131
- Object Code: EF 131
- UM012820-0810 DA Instruction 149
- 0011 1100 = 3Ch 149
- 0000 0110 = 06h 149
- 0100 0010 = 42h 149
- Mnemonic Destination 212
- POP R1 50 R1 — — 212
- POP @R1 51 R1 — — 212
- UM012820-0810 RCF Instruction 221
- Object Code: CF 221
- RL R1 90 R1 — — 225
- RL @R1 91 R1 — — 225
- UM012820-0810 SCF Instruction 238
- Object Code: DF 238
- Op Code Maps 273
- Figure 20. First Op Code Map 275
- Op Codes Listed Numerically 277
- Assembly and Object Code 291
- UM012820-0810 Index 305
- Customer Support 314
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