Zilog Z80380 Bedienungsanleitung Seite 259
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Bewertet. / 5. Basierend auf Kundenbewertungen
U
SER
'
S
M
ANUAL
Z
ILOG
Table D-1. Instructions operating differently in
Native or Extended mode of operation.
Source Code Object Code
ADD HL,BC 09
ADD HL,DE 19
ADD HL,HL 29
ADD HL,SP 39
ADD IX,BC DD 09
ADD IX,DE DD 19
ADD IX,IX DD 29
ADD IX,SP DD 39
ADD IY,BC FD 09
ADD IY,DE FD 19
ADD IY,IY FD 29
ADD IY,SP FD 39
CALR 123456H FD CD 56 34 12
CALR 1234H DD CD 34 12
CALR 12H ED CD 12
CALR C,123456H FD DC 56 34 12
CALR C,1234H DD DC 34 12
CALR C,12H ED DC 12
CALR M,123456H FD FC
CALR M,1234H DD FC 34 12
CALR M,12H ED FC 12
CALR NC,123456H FD D4 56 34 12
CALR NC,1234H DD D4 34 12
CALR NC,12H ED D4 12
CALR NZ,123456H FD C4 56 34 12
CALR NZ,1234H DD C4 34 12
CALR NZ,12H ED C4 12
CALR P,123456H FD F4 56 34 12
CALR P,1234H DD F4 34 12
CALR P,12H ED F4 12
CALR PE,123456H FD EC 56 34 12
CALR PE,1234H DD EC 34 12
CALR PE,12H ED EC 12
CALR PO,123456H FD E4 56 34 12
CALR PO,1234H DD E4 34 12
CALR PO,12H ED E4 12
CALR Z,123456H FD CC 56 34 12
CALR Z,1234H DD CC 34 12
CALR Z,12H ED CC 12
CPD ED A9
CPDR ED B9
CPI ED A1
CPIR ED B1
DEC BC 0B
DEC DE 1B
DEC HL 2B
DEC IX DD 2B
DEC IY FD 2B
DEC SP 3B
DECW BC 0B
Source Code Object Code
DECW DE 1B
DECW HL 2B
DECW IX DD 2B
DECW IY FD 2B
DECW SP 3B
DJNZ 123456H FD 10 56 34 12
DJNZ 1234H DD 10 34 12
DJNZ 12H 10 12
INC BC 03
INC DE 13
INC HL 23
INC IX DD 23
INC IY FD 23
INC SP 33
INCW BC 03
INCW DE 13
INCW HL 23
INCW IX DD 23
INCW IY FD 23
INCW SP 33
JP (HL) E9
JP (IX) DD E9
JP (IY) FD E9
JR 123456H FD 18
JR 1234H DD 18 34 12
JR 12H 18 12
JR C,123456H FD 38 56 34 12
JR C,1234H DD 38 34 12
JR C,12H 38 12
JR NC,123456H FD 30 56 34 12
JR NC,1234H DD 30 34 12
JR NZ,123456H FD 20 56 34 12
JR NZ,1234H DD 20 34 12
JR NZ,12H 20 12
JR Z,123456H FD 28 56 34 12
JR Z,1234H DD 28 34 12
JR Z,12H 28 12
RET C D8
RET M F8
RET NC D0
RET NS F0
RET NV E0
RET NZ C0
RET P F0
RET PE E8
RET PO E0
RET S F8
RET V E8
RET Z C8
RET C9
RETI ED 4D
- Z80380 CPU 1
- 'S MANUAL 1
- CHAPTER 1 3
- 1.1 INTRODUCTION (Continued) 4
- 1.2 CPU ARCHITECTURE 5
- 1.2.1 Modes of Operation 5
- 1.2.2 Address Spaces 5
- 1.2.3 Data Types 6
- 1.2.4. Addressing Modes 6
- 1.2.5. Instruction Set 6
- 1.2.6 Exception Conditions 6
- 1.3.1 High Throughput 7
- (Continued) 8
- 1.4 SUMMARY 8
- SER'S MANUAL 10
- 2.4 MEMORY ADDRESS SPACE 12
- USER'S MANUAL 15
- DC-8297-03 15
- CHAPTER 2 16
- CHAPTER 3 23
- 3.2 DECODER DIRECTIVES 24
- CHAPTER 4 26
- 4.2.3 Indirect Register (IR) 27
- 4.2.4 Direct Address (DA) 28
- 4.2.5 Indexed (X) 29
- 4.3 DATA TYPES 34
- CHAPTER 5 35
- 5.2.7 Condition Codes 37
- SWAP, and PUSH/POP Group 41
- 5.5.8 Program Control Group 46
- 5.5.11 CPU Control Group 50
- 5.5.12 Decoder Directives 51
- 5.7 EXECUTION TIME 52
- ADD WITH CARRY (BYTE) 54
- ADD WITH CARRY (WORD) 55
- ADD (BYTE) 57
- ADD (WORD) 58
- ADD TO STACK POINTER (WORD) 59
- AND (BYTE) 61
- AND (WORD) 62
- BIT TEST 63
- BANK TEST 64
- CALL RELATIVE 66
- COMPLEMENT CARRY FLAG 67
- COMPARE (BYTE) 68
- COMPARE (WORD) 69
- COMPARE AND DECREMENT (BYTE) 70
- COMPARE AND INCREMENT (BYTE) 72
- COMPLEMENT ACCUMULATOR 74
- COMPLEMENT HL REGISTER (WORD) 75
- DECIMAL ADJUST ACCUMULATOR 76
- DECODER DIRECTIVE 77
- DECREMENT (BYTE) 78
- DECREMENT (WORD) 79
- DISABLE INTERRUPTS 80
- DIVIDE UNSIGNED (WORD) 81
- ENABLE INTERRUPTS 83
- EXCHANGE REGISTER (WORD) 86
- EXCHANGE WITH ACCUMULATOR 89
- EXTEND SIGN (BYTE) 91
- EXTEND SIGN (WORD) 92
- INTERRUPT MODE SELECT 97
- INPUT (BYTE) 98
- INPUT (WORD) 99
- INPUT ACCUMULATOR 100
- INPUT (FROM PAGE 0) 101
- INCREMENT (BYTE) 104
- INCREMENT (WORD) 105
- INPUT AND DECREMENT (BYTE) 106
- INPUT AND DECREMENT (WORD) 107
- INPUT AND INCREMENT (BYTE) 110
- INPUT AND INCREMENT (WORD) 111
- JUMP RELATIVE 115
- LOAD ACCUMULATOR 116
- LOAD IMMEDIATE (BYTE) 117
- LOAD IMMEDIATE (WORD) 118
- LOAD REGISTER (BYTE) 120
- LOAD REGISTER (WORD) 121
- LOAD STACK POINTER 123
- LOAD I REGISTER (WORD) 126
- LOAD CONTROL REGISTER (BYTE) 127
- LOAD AND DECREMENT (BYTE) 130
- LOAD AND DECREMENT (WORD) 131
- LOAD AND INCREMENT (BYTE) 134
- LOAD AND INCREMENT (WORD) 135
- MULTIPLY UNSIGNED (BYTE) 138
- MODE TEST 139
- MULTIPLY (WORD) 140
- MULTIPLY UNSIGNED (WORD) 141
- NEGATE ACCUMULATOR 142
- NEGATE HL REGISTER (WORD) 143
- NO OPERATION 144
- OR (BYTE) 145
- OR (WORD) 146
- OUTPUT DECREMENT MEMORY 147
- OUTPUT INCREMENT MEMORY 151
- OUTPUT (BYTE) 155
- OUTPUT (WORD) 156
- OUTPUT ACCUMULATOR 157
- OUTPUT (TO PAGE 0) 158
- OUTPUT AND DECREMENT (BYTE) 161
- OUTPUT AND DECREMENT (WORD) 162
- OUTPUT AND INCREMENT (BYTE) 163
- OUTPUT AND INCREMENT (WORD) 164
- POP ACCUMULATOR 165
- POP CONTROL REGISTER 166
- POP REGISTER 167
- PUSH ACCUMULATOR 168
- PUSH CONTROL REGISTER 169
- PUSH IMMEDIATE 170
- PUSH REGISTER 171
- RESET BIT 172
- RESET CONTROL BIT 173
- RETURN FROM BREAKPOINT 175
- RETURN FROM INTERRUPT 176
- ROTATE LEFT (BYTE) 178
- ROTATE LEFT (WORD) 179
- ROTATE LEFT (ACCUMULATOR) 180
- ROTATE LEFT CIRCULAR (BYTE) 181
- ROTATE LEFT CIRCULAR (WORD) 182
- ROTATE LEFT DIGIT 184
- ROTATE RIGHT (BYTE) 185
- ROTATE RIGHT (WORD) 186
- ROTATE RIGHT (ACCUMULATOR) 187
- ROTATE RIGHT CIRCULAR (BYTE) 188
- ROTATE RIGHT CIRCULAR (WORD) 189
- ROTATE RIGHT DIGIT 191
- SUBTRACT WITH CARRY (BYTE) 193
- SUBTRACT WITH CARRY (WORD) 194
- SET CARRY FLAG 196
- SET CONTROL BIT 198
- SHIFT LEFT ARITHMETIC (BYTE) 199
- SHIFT LEFT ARITHMETIC (WORD) 200
- SHIFT RIGHT ARITHMETIC (BYTE) 202
- SHIFT RIGHT ARITHMETIC (WORD) 203
- SHIFT RIGHT LOGICAL (BYTE) 204
- SHIFT RIGHT LOGICAL (WORD) 205
- SUBTRACT (BYTE) 206
- SUBTRACT (WORD) 207
- TEST (BYTE) 211
- TEST I/O PORT 212
- EXCLUSIVE OR (BYTE) 213
- EXCLUSIVE OR (WORD) 214
- CHAPTER 6 215
- 6.2 INTERRUPTS (Continued) 216
- 6.2.2 Interrupt Control 216
- 6.3 TRAP INTERRUPT 218
- 6.7 RETI INSTRUCTION 220
- CHAPTER 7 222
- APPENDIX A 225
- APPENDIX B 228
- APPENDIX C 243
- APPENDIX D 258
- APPENDIX E 262
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